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Diseño de un codificador y decodificador digital Reed-Solomon usando programación en VHDL

En este artículo se presenta un procedimiento práctico para el diseño de un codificador/decodificador Reed-Solomon a través de la descripción funcional usando lenguaje descriptor de hardware (VHDL) con la herramienta de programación Xilinx ISE 9.2i. Este trabajo propone un diseño que usa los benefic...

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Bibliographic Details
Main Authors: Sandoval, C., Fedón, A.
Format: Article
Published: Universidad Nacional de Ingeniería 2008
Subjects:
005 Programación de computadores, programas, datos
Online Access:http://ribuni.uni.edu.ni/158/1/1211.pdf
id 158
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spelling 1582022-12-01T20:42:37Z Diseño de un codificador y decodificador digital Reed-Solomon usando programación en VHDL Sandoval, C. Fedón, A. 005 Programación de computadores, programas, datos En este artículo se presenta un procedimiento práctico para el diseño de un codificador/decodificador Reed-Solomon a través de la descripción funcional usando lenguaje descriptor de hardware (VHDL) con la herramienta de programación Xilinx ISE 9.2i. Este trabajo propone un diseño que usa los beneficios que presenta la programación VHDL, su característica de modularidad, y la estrategia de seccionar el diseño en componentes menos complejos para facilitar el proceso. Además, se detalla la metodología del diseño del decodificador a través de procesamiento paralelo. Para la validación del comportamiento del codificador/decodificador, se realizaron simulaciones con el programa ModelSim XE 5.7c. Universidad Nacional de Ingeniería 2008-06 Article PeerReviewed text http://ribuni.uni.edu.ni/158/1/1211.pdf http://revistas.uni.edu.ni/index.php/Nexo Sandoval, C. and Fedón, A. (2008) Diseño de un codificador y decodificador digital Reed-Solomon usando programación en VHDL. Nexo Revista Científica, 21 (1). pp. 2-10. ISSN L 1818-6 http://ribuni.uni.edu.ni/158/
institution Universidad Nacional de Ingenieria
collection Repositorio Institucional-RIBUNI
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Sandoval, C.
Fedón, A.
Diseño de un codificador y decodificador digital Reed-Solomon usando programación en VHDL
description En este artículo se presenta un procedimiento práctico para el diseño de un codificador/decodificador Reed-Solomon a través de la descripción funcional usando lenguaje descriptor de hardware (VHDL) con la herramienta de programación Xilinx ISE 9.2i. Este trabajo propone un diseño que usa los beneficios que presenta la programación VHDL, su característica de modularidad, y la estrategia de seccionar el diseño en componentes menos complejos para facilitar el proceso. Además, se detalla la metodología del diseño del decodificador a través de procesamiento paralelo. Para la validación del comportamiento del codificador/decodificador, se realizaron simulaciones con el programa ModelSim XE 5.7c.
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